IC技术圈
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类别: FPGA(196) 前端(99) 验证(60) 后端(47) 嵌入式(3) 自动化(8) 模拟(11) 求职就业(98) 管理(6) 软件(6) 按月份
验证阶段思考——反馈&升级
#验证 #覆盖率 #风险识别
阿辉说
UVM实战[三]
#验证 #UVM
摸鱼范式
PMP质量保证和质量控制在IC验证中的实践与思考
#管理 #项目管理 #验证 #质量
ExASIC
[十四]Cracking Digital VLSI Verification Interview
#求职就业 #笔试面试 #验证 #UVM
摸鱼范式
UVM实战[二]
#验证 #UVM #Testbench搭建
摸鱼范式
[systemverilog]reg、wire、var和logic傻傻分不清
#验证 #SystemVerilog #语法 #两态四态
数字IC小站
验证阶段思考——“清单思维”
#验证
阿辉说
当我们做后仿时我们究竟在仿些什么
#验证 #后仿
icsoc
SystemVerilog中Assertions
#验证 #断言
数字IC小站
SystemVerilog的一个简单验证demo
#验证 #SystemVerilog #demo
数字IC小站
SystemVerilog和UVM到底是啥关系?
#验证 #SystemVerilog #UVM
数字芯片实验室
啥?100个agent?这个台子怎么搭?
#验证 #UVM
杰瑞IC验证
SystemVerilog面试题(26-30)
#求职就业 #笔试面试 #验证 #SystemVerilog
数字芯片实验室
验证面试攻略专辑
#求职就业 #笔试面试 #验证
摸鱼范式
UVM常考概念题
#求职就业 #笔试面试 #验证 #UVM
数字IC小站
IC验证工程师高效战斗手册
#求职就业 #验证
杰瑞IC验证
用SV写一个蒙哥马利算法的参考模型
#验证 #参考模型 #SystemVerilog
摸鱼范式
[400题]验证工程师面试宝典-完结篇
#求职就业 #笔试面试 #验证
摸鱼范式
IC验证工程师高效战斗手册--提问之道(上篇)
#求职就业 #验证
杰瑞IC验证
AXI总线,关于“贩毒交易”“火车”“马匪”的故事<一>
#前端 #AXI总线 #IC验证 #协议
杰瑞IC验证
谈谈UVM中的Factory机制
#验证 #UVM
数字芯片实验室
Verilog仿真事件队列
#验证 #Verilog
精进攻城狮
你的case真的pass了吗?
#验证 #UVM
杰瑞IC验证
人人都会用到,但是大部分人不清楚是什么的“神秘空间”
#验证 #SystemVerilog
杰瑞IC验证
Systemverilog中的Process(1)--产生进程的方式
#验证 #SV
杰瑞IC验证
IC验证工程师高效战斗手册--接到验证任务与前期高效学习
#验证 #效率 #流程
杰瑞IC验证
我的第一个UVM代码——Hello world
#验证 #UVM
ExASIC
当我们做后仿时我们究竟在仿些什么(四)
#验证 #后仿 #门级仿真
icsoc
我的第二个UVM代码——连接interface
#验证 #UVM
ExASIC
验证工程师经常犯的错误(4)---符号位扩展问题
#验证 #SV
杰瑞IC验证
IC验证工程师高效战斗手册---提问之道(下篇)
#验证 #职场 #效率
杰瑞IC验证
更强、更快、更实用 EpicSim,全球速度最快的开源数字仿真器
#验证 #开源 #EDA
EDAGit开源社区
手把手教你如何使用SV宏
#验证 #SV宏#macro
IC验证分享圈
手把手教你使用条件编译
#验证 #条件编译#macro
IC验证分享圈
我的第三个UVM代码——把testcase与driver分开
#验证 #UVM
在本示例中没有env、agent、sequencer、sequence等组件,属于一个简化的验证环境,主要是由于分步演示的需要。侧面也说明UVM是一个灵活的验证架构,可以根据自己的需要进行裁剪。
ExASIC
你还在用plusargs传递参数吗?来试试这个玩法~
#验证 #UVM #SV
当面对很多验证组件,并且有很多命令行参数需要传递的时候,如何才能简单的实现给这些组件传递命令行参数呢?
杰瑞IC验证
IC验证工程师高效战斗手册--验证feature文档梳理
#验证 #效率 #流程
本文我们一起探讨如何又快又好的梳理验证测试点这个文档?怎样在验证过程中充分使用这个文档?
杰瑞IC验证
SystemVerilog与功能验证方法学
#验证 #FPGA# #UVM#SystemVerilog#
介绍SyetemVerilog与功能验证技术和方法学,为有效提高验证效率找方法。
科学文化人
Win10 WSL + Linux 开源 EDA(三)
#验证 #开源 #EDA
本期介绍一款开源的 VCD 波形查看器。
icsoc
数字系统仿真验证方法 —— 华山论剑
#前端 #数字IC#仿真#验证#IP设计
数字IP/IC仿真验证方法梳理。
SiliconThink
一个加法器的UVM验证平台设计
#验证 #UVM #IC验证 #验证平台搭建
以入门的角度进行一个加法器的UVM验证平台设计
Andy的ICer之路
SystemVerilog中的Process(2)--进程的控制
#验证 #SV
本文主要讲解named block、wait _order、wait _fork、disable、SystemVerilog中的内建process类等
杰瑞IC验证
SV中import和include的区别
#验证 #SV
此公众号主要分享数字IC相关的学习经验,做公众号的目的就是记录自己的学习过程,这篇文章主要介绍SV中import和include的区别
Andy的ICer之路
IC验证er一起学点设计模式(1)---单例模式
#验证 #SV #UVM #面向对象
众所周知,目前IC验证行业使用最主流的语言是SystemVerilog,这个语言有一个重要特点就是它是面向对象的语言。对于面向对象的语言,想要把代码写得更“牛逼”,其实就绕不开一个概念叫“设计模式”。
杰瑞IC验证
数字IC设计与数字IC验证哪个好?
#验证 #IC设计#IC验证#
详细解读了数字IC设计与数字IC验证的区别、前景等等
ZYNQ
​数据存储和传输的大小端问题
#验证 #前端
吃茶叶蛋的时候,你会先磕破鸡蛋比较小的那一端,还是比较大的那一端?
杰瑞IC验证
SV开源库svlib学习
#验证 #sv #验证
开源库svlib的学习使用
摸鱼范式
数字芯片设计验证-秋招指南
#求职就业 #求职 #设计 #验证 #攻略
保姆级备战秋招指南
摸鱼范式
EasySim: 一个简单的仿真脚本 v1.1
#自动化 #验证 #python
EasySim v1.1版支持: - 切换仿真器irun、xrun、vcs,在conf.json里指定。 - 支持打开Verdi,并支持只打开RTL。 - 增加了options可以仿真fpga代码,支持多顶层。 - 增加了dryrun,只打印最终的cmd,但不运行,方便调试脚本本身的错误。 - 支持灵活的timescale,功能仿真用粗精度,后仿用高精度,支持从conf文件里覆盖timescale。
ExASIC
验证仿真提速系列--SystemVerilog编码层面提速的若干策略
#验证 #SystemVerilog #UVM
随着设计复杂度和规模增加,验证平台复杂度跟着增加。验证平台的仿真速度问题成为验证过程中一个重要问题…
杰瑞IC验证
2021年,IC验证还值得转吗?
#验证 #IC验证 #就业 #求职 #芯片 #秋招
近几年,IC行业成为了就业的热门,国内一线大厂为优秀的应届毕业生开出了40万的年薪,赚足了眼球。对于材料,化学等专业的学生来说,转行IC成为了趋势。就2021年的现状来看,IC验证还值得转吗?
OpenIC
芯片行业哪些人能达到年薪百万?
#求职就业 #验证 #IC验证 #就业 #求职 #芯片 #秋招 #薪资 #前端设计
芯片行业薪资大揭秘,看看你的上限在哪里!
OpenIC
+vcs+initreg+random、xprop、后仿讨论总结
#验证
萌新来啦
关于reset的一些做法
#验证
萌新来啦
由屏蔽某些UVM_ERROR想到的
#验证
萌新来啦
IC验证工程师高效战斗手册--如何制定高效的验证方案
#验证 #提效
当我们完成了前期的充分学习,对验证对象有所理解、有了初步验证思路、提取出了验证feature,就到了制定完善具体的验证方案了,验证方案如同作战方案,是行动高效的保证,从作战意识到作战策略,都很重要。如何才能制定出高效的验证方案呢?
杰瑞IC验证
数字IC设计知识结构
#前端 #数字IC知识结构 #前端 #后端 #验证
IC 定义,芯片各个节点分工,数字IC设计全流程:前端设计 、物理实现 和功能验证,总结知识结构。
FPGA自习室
你真的了解“随机”这两个字意味着什么吗?
#验证 #随机
你真的了解“随机”这两个字意味着什么吗?“随机”这两个字,隐藏着哪些工作需要做呢?
杰瑞IC验证
芯片可靠性介绍
#前端 #IC验证 #就业 #求职 #芯片 #秋招
OpenIC
科普 | 人工智能(AI)芯片大乱斗
#前端 #验证 #IC验证 #就业 #求职 #芯片 #秋招 #薪资 #前端设计
OpenIC