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#FPGA #SpinalHDL #图像处理

针对FPGA图像处理的Sobel检测算法，以SpinalHDL为开发语言进行实现，相较于Verilog，能够在不损失性能条件下快速进行算法验证。

#FPGA #SpinalHDL

我们在编写Verilog代码时，代码的的组织往往是按照module来组织的，而在SpianlHDL里，与之相对的是Component，SpianlHDL里我们编写的每个class继承Component则与之对应的在生成RTL时会相对生成一个module

似猿非猿的FPGA

SpinalHDL—像软件调用方法般例化模块

#FPGA #SpinalHDL

在编写Verilog代码时最痛苦的事情便是例化模块时端口的连接，这时候的你我便成了连线工程师，本节就在SpinalHDL中如何像软件调用方法那样优雅地例化端口进行探讨。

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SpinalHDL—Area

#FPGA #SpinalHDL

在我们编写Verilog或者SysytemVerilog时，我们的代码基本都以module来进行组织，而针对一些比较通用的模块组件，我们或组织成一个单独的model，或者放在一个function中(仅限于纯组合逻辑)。本篇介绍SpinalHDL中的Area的概念。

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SpinalHDL—Function

#FPGA #SpinalHDL

聊一聊SpinalHDL中Function的使用，软为硬用。

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SpinalHDL—if向左、when向右

#FPGA #SpinalHDL

聊一聊如何理解SpinalHDL中scala原有语法和SpinalHDL中生成电路语法的角色扮演

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从Verilog到SpinalHDL

#FPGA #SpinalHDL

SpinalHDL目前用的人不多，但小家碧玉未尝不是绝代佳人，SpinalHDL系列笔记，感兴趣的小伙伴可以关注下，习惯了SpinalHDL你不会再想手写Verilog

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你刚写完接口，我已经把功能实现了

#FPGA #SpinalHDL

三两行代码实现一个模块，让工作轻松一点儿不好么。SpinalHDL加速电路设计

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从Verilog到SpinalHDL

#FPGA #SpinalHDL

“小家碧玉”未尝不是绝代佳人。

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跨时钟域那点事儿

#FPGA #SpinalHDL

每一个做数字逻辑的都绕不开跨时钟域处理，谈一谈SpinalHDL里用于跨时钟域处理的一些手段方法。

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时钟域“定制”

#FPGA #SpinalHDL

聊一聊在SpinalHDL里时钟域中时钟的定制与命名。

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与其在一起纠缠，不如“一别两宽”

#FPGA #SpinalHDL

在SpinalHDL里，其lib库处处可见Stream的身影，而在常用的逻辑设计里，尤其接口的处理中，握手信号的处理也是老生常谈的话题。而在接受设计里，SpinalHDL中的“一别两宽”式设计方式，着实让我赞同。

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“IP”库生成

#FPGA #SpinalHDL

基于IDEA生成jar包导出个人SpinalHDL IP设计。

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你想要的马車520直播回放链接在这里

#FPGA #SpinalHDL

马車昨晚关于Spinal520直播你看了么

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除了看波形，还能做点儿啥

#FPGA #SpinalHDL

要问做逻辑的什么看的最久，那一定是波形吧。那除了看波形，还能做点儿其他的么？

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一键生成寄存器文档也容易

#FPGA #SpinalHDL

一键生成整个设计的寄存器文档

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若可以选,我宁愿重写曾经的“无聊”代码

#FPGA SpinalHDL

今天，再来好好聊聊SpinalHDL中的FIFO。也许你是逻辑设计老手，但好好看看这篇文章，或许你也会有新的思考。

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从Verilog到SpinalHDL

#FPGA SpinalHDL

该篇文章会不定期更新推送，用以同步公众号内所有和SpinalHDL文章归类汇总，多谢支持。

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你知道如何做多端口仲裁么

#FPGA SpinalHDL

该小系列就SpinalHDL中关于StreamArbiter部分从基础原理到最终的实现细节进行总结。本篇先从roundRobin讲起。

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halfPipe是如何导致带宽减半的

#FPGA SpinalHDL

Stream中的halfPipe方法为什么会导致带宽减半？

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推荐几个挺不错的功能

#FPGA SpinalHDL

推荐几个SpinalHDL新版本引入的几个挺不错的API方法使用。

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