IC技术圈期刊 文章分类

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2021秋招总结(器件方向转行数字IC设计)
#求职就业  #求职  #面试经验  #数字设计 
本文分享了器件转数字设计的成功校招笔试和面试经历。
数字芯片设计
数字后端面试高频问题
#后端  #数字IC  #后端  #求职  #面试  #芯片物理设计 
数字后端相比于前端门槛较高,但知识技能树非常清晰,包括:data setup、floorplan、placement、cts、routing、DFM、DRC/LVS、ECO等。本公众号推出的专题——“后端面试高频问题”分模块对数字芯片物理设计相关知识点进行了整理,以帮助大家轻松应对数字后端的笔面试。
数字IC剑指offer
BUF、BUFG、BUFGCE、BUFR、IBUF、IBUFDS、IDDR、ODDR
#FPGA  #fpga  #c++  #数字ic  #面试 
欢迎关注微信公众号《精进攻城狮》,不断分享FPGA、IC、C++相关笔试面试题。
精进攻城狮
FPGA手撕代码——CRC校验码的多种Verilog实现方式
#求职就业  #FPGA  #笔试面试  #数字IC  #CRC  #求职就业 
用Verilog实现CRC-8的串行/并行计算,G(D)=D8+D2+D+1,多种实现方式,秋招求职必备,另外介绍2个工程中的CRC生成网站,可以用于实际工程开发。
FPGA探索者
FPGA/数字IC笔试题——序列检测(FSM状态机)【状态机序列检测】
#求职就业  #FPGA  #秋招  #笔试面试  #FSM状态机 
FSM有限状态机,序列产生,序列检测,是FPGA和数字IC相关岗位必须要掌握的知识点,在笔试和面试中都非常常见。
FPGA探索者
数字IC校招笔试面试题汇总
#前端 #笔试题#面试题 
一网打尽校招笔试面试,助你拿offer!
数字ICer
国外的数字IC面试题(非常详细,有答案)
#求职就业  #面试题  #数字IC 
国外数字IC面试题。内容相对比较基础,有答案
ZYNQ
求职面试 | FPGA面试题汇总篇
#FPGA  #FPGA面试题  #硬件工程师面试题  #通信算法工程师面试题 
几百道FPGA工程师参考面试题汇总,数字电路基础以及FPGA专业方向应有尽有。
FPGA技术江湖
三个月转数字IC小白的找工作心说
#求职就业  #数字IC 面试经验  #IC面试  #FPGA 
容 本文大约 6000 字,是一名 3 个月转 IC 小白的工作面试心得。不作为正常、普遍的学习 IC 的学生应该有的经历,但也许能为找 IC 行业工作的你提供些许帮助,欢迎阅读参考。
数字IC与硬件设计的两居室
IC验证学习路线(干货满满!)
#验证  #IC验证  #学习路线  #面试面经  #知识分享 
酒酒总结的IC验证学习路线(附资料,面试面经,IC验证面试常问88道总结,IC面试手撕代码总结,IC设计问题总结)
酒酒聊IC编程
酒酒爆肝80道大厂高频面试题
#验证  #IC验证  #IC设计  #面试面经 
酒酒总结的IC设计问题(比较全面)
酒酒聊IC编程
酒酒拿下四五十万的真实大厂面试经历
#验证  #IC验证  #IC设计  #面试面经 
酒酒提前批面试面经总结(大概30家公司面经总结,zeku,展锐,联发科,华为,寒武纪,地平线,商汤,奥比中光,集创北方。。。。。。)
酒酒聊IC编程
数字IC岗位,HR常问的44个问题
#求职就业  #IC设计  #面试面经  #IC验证 
整理了一些HR面试或者综合面试时,面试官常常问的一些问题,建议大家秋招面试的时候提前看一眼,做到心中有数~
IC媛
从零开始 verilog 以太网交换机(一)架构分析
#前端  #FPGA  #交换机  #面试项目  #网络 
当下很多IC设计的求职者可能苦于找不到合适的项目,或者是希望有一个区别于培训班的独特项目,所以博主从今天开始会根据一些资料,完成一个以太网交换机的手把手教学,并将所有工程代码开源。 关注本专题的朋友们可以收获一个经典交换机设计的全流程;以太网MAC的基础知识。新手朋友们还将获得一个具有竞争力的项目经历。
IC摸鱼仔
从零开始 verilog 以太网交换机(二)MAC接收控制器的设计与实现
#前端  #FPGA  #交换机  #面试项目  #网络 
本章进行MAC控制器的设计与实现,共分为两个部分:接收控制器和发送控制器。整体架构可以参考:从零开始 verilog 以太网交换机(一)架构分析,本文将首先分析MAC接收控制器的设计
IC摸鱼仔
从零开始 verilog 以太网交换机(三)MAC发送控制器的设计与实现
#前端  #FPGA  #交换机  #面试项目  #网络 
本章将继续进行MAC发送端控制器的设计与实现,交换机完整的架构可以参考:从零开始 verilog 以太网交换机(一)架构分析。
IC摸鱼仔
数字设计笔试Verilog手撕代码 - 浮点加法器
#求职就业  #笔试面试 
今天在网上看笔试题发现有个设计浮点累加器的题目,看了下题目说明感觉不太清楚,恰好记得之前做过浮点数的加法运算的设计,索性就改了下题目需求,作为一个小练习在重新设计一遍。
FPGA and ICer
数字设计笔试Verilog手撕代码 - 累加器
#求职就业  #笔试面试 
本系列整理关于数字设计的笔试或面试的设计问题,手撕代码继续撕,今天撕一个百度昆仑笔试题的累加器设计。
FPGA and ICer