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进入IP Core的时钟，都不需要再手动添加约束么？
进入IP Core的时钟，都不需要再手动添加约束么？
#FPGA  #Xilinx  #时序约束 
很多FPGA工程师都认为，凡是进入到IP Core的时钟，IP都会自动进行约束，不需要再手动加约束，是这样的么？
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