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分享数字IC前端设计、FPGA相关知识。总结、记录自己的学习过程,一个硅农的进阶之路。
Verilog如何实现低功耗设计?
#FPGA  #ASIC  #FPGA 
做芯片第一应该关注的是芯片的PPA(Performance, Power, Area),本篇浅显的部分讨论,第二个 P,Power功耗,在RTL设计中如何做到低功耗设计,对于移动设备续航的十分重要,不要让你的芯片徒增功耗。
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写Verilog如何做到心中有电路?
#前端  #ASIC  #Verilog 
学习Verilog的五个阶段 00:心中无电路,代码无电路 01:心中有电路,代码无电路 10:心中有电路,代码有电路 11:心中无电路,代码有电路 00:心中无电路,代码无电路
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Verilog代码设计之时分复用
#FPGA  #ASIC  #Verilog 
复用虽好,但也要适时、适度。
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如何写出高覆盖率的Verilog代码?
#前端  #ASIC  #Verilog 
芯片前端工程中,测试验证的核心理念:以提高覆盖率为核心。
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如何写出让同事无法维护的Verilog代码?
#前端  #ASIC  #Verilog 
对,你没看错,本文就是教你怎么写出让同事无法维护的代码。
硅农
RV双周报:谷歌公布RISC-V安卓计划,新思全面转向RV架构(第70期-20231115)
#资讯  #RISCV  #期刊 
谷歌方面最近公布了一系列Android平台对于开源架构RISC-V的未来支持计划;RISC-V服务器芯片设计厂商Ventana Micro Systems发布了其第二代服务器CPU——Veyron V2;DynamoRIO是性能优化工程师常用的剖析工具之一,能够以较低的开销抓取软件运行的 workload 并进行修改,常被用于指导 CPU 的设计空间探索、程序优化、安全分析等领域,包括华为、Google等国内外知名企业均在使用
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