IC技术圈期刊

#验证

分享一种使用bind和uvm_config进行interface连接复用的方法:UVM harness.

#FPGA #神经网络 #硬件加速

本文将介绍一种特殊的硬件加速方案，一种INT8数据精度下的双倍算力提升方案。目前大部分卷积神经网络模型的数据类型都是32-bits单精度浮点型，或者16-bits，但对于实际应用而言，99%和99.5%的网络准确率是没有区别的。所以，对于某些场景下，网络的数据精度使用INT8的数据类型就能较好的胜任工作。

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源码系列：基于FPGA实时时钟的设计（附源工程）

#FPGA #实时时钟 #源码分享 #DS1302芯片 #架构设计

本次设计采用了美国DALLAS公司推出的一种高性能、低功耗、带RAM的实时时钟电路 DS1302，它可以对年、月、日、周、时、分、秒进行计时，具有闰年补偿功能，工作电压为2.5V~5.5V。采用三线接口与CPU进行同步通信，并可采用突发方式一次传送多个字节的时钟信号或RAM数据。

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从零开始 verilog 以太网交换机（一）架构分析

#前端 #FPGA #交换机 #面试项目 #网络

当下很多IC设计的求职者可能苦于找不到合适的项目，或者是希望有一个区别于培训班的独特项目，所以博主从今天开始会根据一些资料，完成一个以太网交换机的手把手教学，并将所有工程代码开源。关注本专题的朋友们可以收获一个经典交换机设计的全流程；以太网MAC的基础知识。新手朋友们还将获得一个具有竞争力的项目经历。

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从零开始 verilog 以太网交换机（二）MAC接收控制器的设计与实现

#前端 #FPGA #交换机 #面试项目 #网络

本章进行MAC控制器的设计与实现，共分为两个部分：接收控制器和发送控制器。整体架构可以参考：从零开始 verilog 以太网交换机（一）架构分析，本文将首先分析MAC接收控制器的设计

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从零开始 verilog 以太网交换机（三）MAC发送控制器的设计与实现

#前端 #FPGA #交换机 #面试项目 #网络

本章将继续进行MAC发送端控制器的设计与实现，交换机完整的架构可以参考：从零开始 verilog 以太网交换机（一）架构分析。

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RFSoC之XilinxWP509阅读笔记 - 了解射频采样数据转换器的关键参数

#FPGA #FPGA #RFSoC

在直接采样 RF 设计中，数据转换器的特征通常是 NSD、IM3 和 ACLR 参数，而不是 SNR 和 ENOB 等传统指标。在软件定义无线电和类似的窄带用例中，量化落入感兴趣频段的数据转换器噪声量更为重要；传统数据转换指标不适合这样做。本白皮书首先介绍了传统 ADC 参数（SFDR、SNR、SNDR (SINAD) 和 ENOB）背后的数学关系，并说明了为什么这些指标可以很好地表征宽带应用（例如超外差接收器）中的数据转换器。然后描述了为什么这些指标不适用于不能在其全部奈奎斯特带宽上运行的数据转换器，如在 SDR 等直接射频采样应用中。详细介绍了 NSD、IM3 和 ACLR 的推导和测量。

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用python发邮件（SMTP SSL协议）

#自动化 #python

本文介绍了用python发邮件（SMTP SSL协议）的方法，在芯片设计自动化中有比较广泛的应用。

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IC技术圈期刊 2023年 第02期

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