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Verilog代码设计之 “神精匠工”
#前端  #Verilog 
硅农
连续两个月996是一种什么样的体验?
#管理  #研发管理  #效率  #加班 
硅农
Verilog几个这样的写法
#FPGA  #Verilog 
硅农
Verilog有什么奇技淫巧?
#前端  #Verilog 
硅农
你要的FPGA&ASIC面试题船新版本!!!
#求职就业  #笔试面试  #FPGA  #ASIC 
硅农
如何将算法代码“翻译”成Verilog?
#前端  #Verilog 
硅农
数字IC设计工程师的一天是怎么样的?
#求职就业  #前端 
硅农
什么是小黄鸭调试法?
#前端  #ASIC  #FPGA 
硅农
如何优化一个设计
#前端  #ASIC  #FPGA 
硅农
Verilog如何实现低功耗设计?
#FPGA  #Verilog  #ASIC 
硅农
Verilog如何实现低功耗设计?
#FPGA  #ASIC  #FPGA 
做芯片第一应该关注的是芯片的PPA(Performance, Power, Area),本篇浅显的部分讨论,第二个 P,Power功耗,在RTL设计中如何做到低功耗设计,对于移动设备续航的十分重要,不要让你的芯片徒增功耗。
硅农
写Verilog如何做到心中有电路?
#前端  #ASIC  #Verilog 
学习Verilog的五个阶段 00:心中无电路,代码无电路 01:心中有电路,代码无电路 10:心中有电路,代码有电路 11:心中无电路,代码有电路 00:心中无电路,代码无电路
硅农
Verilog代码设计之时分复用
#FPGA  #ASIC  #Verilog 
复用虽好,但也要适时、适度。
硅农
如何写出高覆盖率的Verilog代码?
#前端  #ASIC  #Verilog 
芯片前端工程中,测试验证的核心理念:以提高覆盖率为核心。
硅农
如何写出让同事无法维护的Verilog代码?
#前端  #ASIC  #Verilog 
对,你没看错,本文就是教你怎么写出让同事无法维护的代码。
硅农
做IP设计是一个非常幸福的岗位
#前端  #ASIC  #芯片职场 
硅农