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wujian100学习资料
#FPGA  #riscv  #平头哥  #wujian100 
瓜大三哥
把riscv core代码变成网表最少需要几步
#后端  #综合  #riscv 
逻辑综合其实可以很简单,下面以github上一个riscv core cv32e40p的代码(https://github.com/openhwgroup/cv32e40p)为例介绍一下怎么从零开始做综合。
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