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专题 | Innovus 2020: 创新，永无止境
#后端  #pr  #innovus 
陌上风骑驴看IC
SystemVerilog中program提前结束仿真
#验证  #SystemVerilog  #program 
在SystemVerilog中，增加了program...endprogram用于将测试代码集成在其中，从而区分RTL设计代码和测试平台代码在time-slot中执行的区域，其与module...endmodule用法类似，但是还是有些差异，如果使用不当可能会出现一些不期望的问题，本文将主要针对program提前结束仿真的行为与module进行对比说明。
硅芯思见
什么是X态传播？
#验证  #设计  #X态  #VCS  #Xprop 
X态的存在使得仿真结果要么太过于乐观，要么太过于悲观。
ICer消食片
Vivado non-project模式示例
#FPGA  #Vivado  #non-project 
vivado有project模式和non-project模式，project模式就是我们常用的方式，在vivado里面新建工程，通过GUI界面去操作；non-project模式就是纯粹通过tcl来指定vivado的流程、参数。
傅里叶的猫